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CAT28C16A
DEVICE OPERATION
Read
Data stored in the CAT28C16A is transferred to the d at a bus when WE is held high, and both OE and CE are held low. The
data bus is set to a high impedance state when either CE or OE goes high. This 2 ? line control architecture can be used to
eliminate bus contention in a system environment.
t RC
ADDRESS
CE
OE
t CE
t OE
WE
DATA OUT
V IH
HIGH ? Z
t LZ
t OLZ
t AA
t OH
DATA VALI D
t OHZ
t HZ
DATA VALID
Figure 4. Read Cycle
t WC
ADDRESS
CE
OE
t AS
t CS
t AH
t CH
t OES
t WP
t OEH
WE
t DL
DATA OUT
DATA IN
HIGH ? Z
DATA VALID
t DS
t DH
Figure 5. Byte Write Cycle [WE Controlled]
Byte Write
A write cycle is executed when both CE and WE are l ow,
and OE is high. Write cycles can be initiated using either WE
or CE, with the address input being latched on the falling
edge of WE or CE, whichever occurs last. Data, conversely,
is latched on the rising edge of WE or CE, whichever occurs
first. Once initiated, a byte write cycle automatically erases
the addressed byte and the new data is written within 10 ms.
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